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リアルタイムシステムにおけるTLBミスの影響調査と改善手法
https://ipsj.ixsq.nii.ac.jp/records/90681
https://ipsj.ixsq.nii.ac.jp/records/9068117316714-8a7b-41aa-9449-22fb6e7ace84
| 名前 / ファイル | ライセンス | アクション |
|---|---|---|
IPSJ-EMB13028027.pdf (520.9 kB)
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Copyright (c) 2013 by the Information Processing Society of Japan
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| オープンアクセス | ||
| Item type | SIG Technical Reports(1) | |||||||
|---|---|---|---|---|---|---|---|---|
| 公開日 | 2013-03-06 | |||||||
| タイトル | ||||||||
| タイトル | リアルタイムシステムにおけるTLBミスの影響調査と改善手法 | |||||||
| タイトル | ||||||||
| 言語 | en | |||||||
| タイトル | Investigation and Improvement Techniques on the Impact of TLB misses in Real-Time Systems | |||||||
| 言語 | ||||||||
| 言語 | jpn | |||||||
| キーワード | ||||||||
| 主題Scheme | Other | |||||||
| 主題 | プロセッサ・ハードウェア | |||||||
| 資源タイプ | ||||||||
| 資源タイプ識別子 | http://purl.org/coar/resource_type/c_18gh | |||||||
| 資源タイプ | technical report | |||||||
| 著者所属 | ||||||||
| 名古屋大学大学院情報科学研究科 | ||||||||
| 著者所属 | ||||||||
| 名古屋大学大学院情報科学研究科 | ||||||||
| 著者所属 | ||||||||
| 名古屋大学大学院情報科学研究科 | ||||||||
| 著者所属 | ||||||||
| 名古屋大学大学院情報科学研究科 | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| Graduate School of Information Science, Nagoya University | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| Graduate School of Information Science, Nagoya University | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| Graduate School of Information Science, Nagoya University | ||||||||
| 著者所属(英) | ||||||||
| en | ||||||||
| Graduate School of Information Science, Nagoya University | ||||||||
| 著者名 |
加藤, 寿和
石川, 拓也
本田, 晋也
高田, 広章
× 加藤, 寿和 石川, 拓也 本田, 晋也 高田, 広章
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| 著者名(英) |
Kato, Toshikazu
Ishikawa, Takuya
Honda, Shinya
Takada, Hiroaki
× Kato, Toshikazu Ishikawa, Takuya Honda, Shinya Takada, Hiroaki
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| 論文抄録 | ||||||||
| 内容記述タイプ | Other | |||||||
| 内容記述 | 近年，大規模化するリアルタイムシステムにおいて，メモリ保護機能が必要となっており，その実現のためにMMUが使用される．MMUでは，TLBというキャッシュ機構を使用するが，TLBミスの発生を予測することは難しく，そのために，最悪実行時間の予測が困難となる．本研究では，まず，リアルタイムシステムにおいて，TLBミスが最悪実行時間へ及ぼす影響を調査する．次に，その影響を低減させるための，TLBロック機能を用いた改善手法を提案する．そして，評価実験により，提案手法の有効性を示す． | |||||||
| 論文抄録(英) | ||||||||
| 内容記述タイプ | Other | |||||||
| 内容記述 | In recent years, memory protection for real-time systems is needed to ensure safety of the systems. The MMU used for memory protection uses the TLB which is a caching mechanism. When using the TLB in real-time systems, the worst-case execution time (WCET) is estimated pessimistically, because it is difficult to predict the occurrence of the TLB misses. In this paper, first, we evaluate the impact of TLB misses on the WCET. Secondly, we propose methods to control the occurrence of TLB misses by using the TLB locking mechanism. The result of evaluation shows the effectiveness of the proposed methods. | |||||||
| 書誌レコードID | ||||||||
| 収録物識別子タイプ | NCID | |||||||
| 収録物識別子 | AA12149313 | |||||||
| 書誌情報 |
研究報告組込みシステム（EMB） 巻 2013-EMB-28, 号 27, p. 1-6, 発行日 2013-03-06 |
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| Notice | ||||||||
| SIG Technical Reports are nonrefereed and hence may later appear in any journals, conferences, symposia, etc. | ||||||||
| 出版者 | ||||||||
| 言語 | ja | |||||||
| 出版者 | 情報処理学会 | |||||||
