| Item type |
SIG Technical Reports(1) |
| 公開日 |
2015-05-19 |
| タイトル |
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タイトル |
トランザクショナルメモリにおける排他的および投機的並行性制御 |
| 言語 |
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言語 |
jpn |
| キーワード |
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主題Scheme |
Other |
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主題 |
メモリ技術 |
| 資源タイプ |
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資源タイプ識別子 |
http://purl.org/coar/resource_type/c_18gh |
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資源タイプ |
technical report |
| 著者所属 |
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名古屋工業大学 |
| 著者所属 |
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名古屋工業大学 |
| 著者所属 |
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名古屋工業大学 |
| 著者所属 |
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名古屋工業大学 |
| 著者所属(英) |
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en |
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Nagoya Institute of Technology |
| 著者所属(英) |
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en |
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Nagoya Institute of Technology |
| 著者所属(英) |
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en |
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Nagoya Institute of Technology |
| 著者所属(英) |
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en |
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Nagoya Institute of Technology |
| 著者名 |
間下, 恵介
三宅, 翔
山田, 遼平
津邑, 公暁
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| 論文抄録 |
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内容記述タイプ |
Other |
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内容記述 |
マルチコア環境では，一般的にロックを用いて共有変数へのアクセスを調停する．しかし，ロックには並列性の低下やデッドロックの発生などの問題があるため，これを補完する並行性制御機構としてトランザクショナルメモリが提案されている．この機構をハードウェア上で実現したハードウェアトランザクショナルメモリではアクセス競合が発生しない限りトランザクションが投機的に実行される．しかし，共有変数に対する複合操作が行われるようなトランザクションが並行実行された場合，その際に発生するストールが無駄となる場合がある．そこで本稿では，このような複合操作を検出し，それに関与するトランザクションを排他実行する手法に加え，同一の共有変数に対してそれ以降変更が行われないと判断した時点で，他スレッドによる投機的アクセスを許可する手法を提案する．シミュレーションによる評価の結果，提案手法により 16 スレッド実行時において最大 67.2%，平均 13.9% の性能向上を達成した． |
| 書誌レコードID |
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収録物識別子タイプ |
NCID |
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収録物識別子 |
AN10096105 |
| 書誌情報 |
研究報告システム・アーキテクチャ（ARC）
巻 2015-ARC-215,
号 13,
p. 1-10,
発行日 2015-05-19
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| ISSN |
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収録物識別子タイプ |
ISSN |
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収録物識別子 |
2188-8574 |
| Notice |
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SIG Technical Reports are nonrefereed and hence may later appear in any journals, conferences, symposia, etc. |
| 出版者 |
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言語 |
ja |
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出版者 |
情報処理学会 |
IPSJ-ARC15215013 (2.2 MB)
